在VHDL中，用语句（）表示ciock的下降沿。

lk2025-04-22 5

题目：在VHDL中，用语句（）表示ciock的下降沿。

A. clock̛ ̛̛̛̛̛EVENT

B. clock̛ ̛EVENT AND clock= ̛ 1̛

C. clock=̛ 0̛

D. ̛̛clock̛ ̛EVENT AND clock= ̛ 0̛

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