TTL门输入端口为“与”逻辑关系时，多余的输入端可处理；TTL门输入端口为 “或” 逻辑关系时，多余的输入端应接电平；CMOS门输入端口为“与”逻辑关系时，多余的输入端应接电平，具有“或”逻辑端口的CMOS门多余的输入端应接电平；即CMOS门的输入端不允许

lk2025-02-02 4

题目：TTL门输入端口为“与”逻辑关系时，多余的输入端可处理；TTL门输入端口为 “或” 逻辑关系时，多余的输入端应接电平；CMOS门输入端口为“与”逻辑关系时，多余的输入端应接电平，具有“或”逻辑端口的CMOS门多余的输入端应接电平；即CMOS门的输入端不允许。

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